熟練 SystemVerilog 的兩個關鍵方面，以確保所有驗證工作的品質和完整性。
從這 4.5 小時的課程，你會學到
- 學習斷言( Assertions )和功能覆蓋( Functional Coverage )的概念以及如何使用 SystemVerilog 語言來實現斷言和功能覆蓋
- 透過範例和作業獲得實務經驗
- 將這些關鍵技能添加到你的個人資料中，這是在當前行業中獲得任何驗證工作所必需的
要求
- 驗證中的基本概念
- 渴望學習功能驗證工作所需的重要技能
課程說明
本課程將幫助你了解有關係統 Verilog 斷言 ( System Verilog Assertions，SVA) 和功能覆蓋編碼的所有知識，這些編碼構成了基於斷言和覆蓋驅動驗證方法的基礎。 這是目前所有 SOC/晶片設計中最廣泛使用的兩種關鍵方法，以確保品質和完整性。
本課程涵蓋了從概念到編碼的所有內容，並提供了幾個範例來說明以及測驗和實驗練習，以使你的學習更加透徹。
課程內容包括 LRM 和其他有關 SystemVerilog 的流行書籍中的幾個範例和插圖。
目標受眾
- VLSI /數位/嵌入式設計的學生正在尋找前端 VLSI 設計工作
- 想要提升技能的專業邏輯設計與驗證工程師
講師簡介
Ramdas Mozhikunnath M 專家驗證工程師，英特爾校友，18 年以上經驗，作者
經驗豐富、充滿熱情的驗證工程師，在英特爾、IBM 等大型半導體公司和其他令人興奮的新創公司的複雜微處理器、ASIC 和 SOC 設計驗證方面擁有 18 年以上的經驗。
亞馬遜上有 “Cracking Digital VLSI Verification Interviews: Interview Success“《破解數位 VLSI 驗證訪談：訪談成功》一書的合著者
熱衷於不斷學習新的、有趣的技術，並隨時準備分享知識和幫助他人
Quora 2017 年、2018 年 VLSI/半導體主題最佳作家
字幕：英文
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