使用 FPGA 和 VHDL 設計並建立一個功能齊全的鬧鐘：從概念到硬體實現
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FPGA 嵌入式設計，第 4 部分－微處理器設計
從基礎知識開始學習 FPGA 嵌入式應用設計，最終擁有自己的 CPU。
Continue reading “FPGA 嵌入式設計，第 4 部分－微處理器設計”FPGA 高階合成，第 3 部分 – 進階篇
使用 Vitis-HLS( High-Level Synthesis，高階合成 ) 進行邏輯設計
Continue reading “FPGA 高階合成，第 3 部分 – 進階篇”FPGA101：使用 Verilog 和 Python 進行數位系統設計
從 Verilog 基礎知識到建立 Google TPU 的微型版本
Continue reading “FPGA101：使用 Verilog 和 Python 進行數位系統設計”FPGA 嵌入式設計，第 3 部分 – EDA 工具
學習使用四種不同的工具進行FPGA嵌入式應用設計。
Continue reading “FPGA 嵌入式設計，第 3 部分 – EDA 工具”VLSI/FPGA 設計 P1：CMOS 閘與算術資料通路
奠定 SOC 和 FPGA 設計的基礎
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Verilog HDL 數位設計與驗證基礎知識
透過實現組合/順序數位電路和測試平台建立強大的 Verilog 語言基礎
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從頭開始使用 Verilog HDL 建置處理器
使用 Xilinx Vivado 2020.2
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